ハードウェア設計（FPGA・ASIC、Custom LSIなど）／年間休日124日・50歳以上も活躍中企業の画像1枚目

株式会社キャストリコの電気設計(回路・制御)求人（正社員）

ハードウェア設計（FPGA・ASIC、Custom LSIなど）／年間休日124日・50歳以上も活躍中企業

募集状況確認日:2025年12月26日/応募集まり次第終了
年収400万円〜750万円
シニア活躍中
50代活躍中
60代活躍中
70代以上活躍中
完全週休2日制
フレックス制あり
年休120日以上
Web面接可能
学歴不問
社保完備
定年65歳以上
東京都 中央区 晴海1-8-12　晴海アイランド トリトンスクエアオフィスタワーZ 29階 / 勝どき駅
仕事内容
FPGA・ASIC、Custom LSIなどのハードウェア設計の開発をお任せします。 ■仕事内容 お客様先での常駐開発、お客様からのご要件に基づいた受託開発 ■開発分野・製品例 画像表示装置・システム、画像検査装置、モバイルネットワーク、メモリなど ■開発環境 VerilogHDL、VHDLなど まずはご応募お待ちしております！
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給与について

給与
月給243,000円〜450,000円
想定年収： 400万円 〜 750万円
固定残業代 月 20時間分含む（超過分別途支給）
別途、役職手当・家族手当などあり 固定残業時間：20時間もしくは45時間／月 ＊詳細は経験・スキル・前職給与を考慮の上決定いたします。
賞与
賞与あり
年2回

応募条件について

必要な経験

[ 必須経験 ]

  • VHDL(直近5年以内での)経験 5年以上
  • VerilogHDL(直近5年以内での)経験 5年以上
  • デジタル回路設計(直近5年以内での)経験 10年以上

いずれかの経験で可

[ 歓迎経験 ]

FPGA/LSIのご経験＊経験年数関係なし

必要な資格
不問

勤務日数・休日について

勤務日数
週 5 〜 5日
勤務時間
  • 07:00 ～ 21:00 (休憩60分)
フレックスタイム制 ・コアタイム 10:00～16:00 ・フレキシブルタイム 7:00～10:00/16:00～21:00 ・標準的な勤務時間帯 9:00～18:00 プロジェクトによっては、フレックスタイム制でないなど変動する場合あり
月平均残業
残業あり　月平均 20 時間 〜 20 時間
休日・休暇
土・日・祝
夏季休暇、年末年始休暇 有給休暇 特別休暇・慶弔休暇

勤務地について

勤務地
■東京都 中央区 晴海1-8-12　晴海アイランド トリトンスクエアオフィスタワーZ 29階
・最寄り駅／  勝どき駅 
車通勤
不可
寮・社宅

なし

受動喫煙対策
禁煙

シニア層の活躍・採用について

50歳以上の活躍状況
現在50代30〜39名、60代10〜19名、70代1名が在籍しています。 67歳、59歳、56歳、52歳の採用実績がありますので、年齢に気負いせずご応募ください。
最高年齢
70歳
50歳以上の平均勤続年数
11年
求めるシニア像
コツコツ仕事が出来る
真面目な性格
協調性がある
技術力がある
教え上手
穏やかな雰囲気

福利厚生・待遇について

福利厚生

雇用保険・労災保険・健康保険・厚生年金 通勤手当支給（全額支給） 健康診断 健康保険組合 あんしん財団加盟 AIG業務損害保険加入 研修制度

仕事に慣れるまでの制度
  • OJT形式
  • 社内研修あり
  • 研修期間あり
  • いつでも質問出来る体制
  • チーム制

雇用について

募集職種
電気設計(回路・制御)
雇用形態
正社員
試用期間
あり
6か月　同条件
定年
あり (65歳)
再雇用
あり (70歳)
再雇用上限後の雇用
なし

選考について

選考フロー
1

1次面接(適性検査・テストあり)

2

最終面接

採用人数
1人
Web面接
可能
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募集状況確認日:2025年12月26日/応募集まり次第終了

応募に関するよくある質問

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